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基于FPGA的铁轨检测算法设计与研究
本文实现基于FPGA的铁轨检测算法，首先完成OpenCV程序仿真，然后移植到FPGA构建的硬件系统中，可以成功检测出铁轨所在区域，并在一定条件下进行铁轨智能延长。研究结果表明，检测一幅分辨率为640×480图像，大约需要30 s，如果应用于实时视频流系统中，则硬件平台设计需要进行精简，以提高速度。也可考虑基于硬核、多核技术，来提高处理速度，以满足实时视频流处理。
FPGA图像处理结果如图5所示。
图5 程序流程图
本文实现基于FPGA的铁轨检测算法，首先完成OpenCV程序仿真，然后移植到FPGA构建的硬件系统中，可以成功检测出铁轨所在区域，并在一定条件下进行铁轨智能延长。研究结果表明，检测一幅分辨率为640×480图像，大约需要30 s，如果应用于实时视频流系统中，则硬件平台设计需要进行精简，以提高速度。也可考虑基于硬核、多核技术，来提高处理速度，以满足实时视频流处理。
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